cachepc-linux

Fork of AMDESE/linux with modifications for CachePC side-channel attack
git clone https://git.sinitax.com/sinitax/cachepc-linux
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tpc2_rtr_regs.h (12352B)


      1/* SPDX-License-Identifier: GPL-2.0
      2 *
      3 * Copyright 2016-2018 HabanaLabs, Ltd.
      4 * All Rights Reserved.
      5 *
      6 */
      7
      8/************************************
      9 ** This is an auto-generated file **
     10 **       DO NOT EDIT BELOW        **
     11 ************************************/
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     14#define ASIC_REG_TPC2_RTR_REGS_H_
     15
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     17 *****************************************
     18 *   TPC2_RTR (Prototype: TPC_RTR)
     19 *****************************************
     20 */
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    217
    218#define mmTPC2_RTR_HBW_RANGE_BASE_L_2                                0xE804C8
    219
    220#define mmTPC2_RTR_HBW_RANGE_BASE_L_3                                0xE804CC
    221
    222#define mmTPC2_RTR_HBW_RANGE_BASE_L_4                                0xE804D0
    223
    224#define mmTPC2_RTR_HBW_RANGE_BASE_L_5                                0xE804D4
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    226#define mmTPC2_RTR_HBW_RANGE_BASE_L_6                                0xE804D8
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    228#define mmTPC2_RTR_HBW_RANGE_BASE_L_7                                0xE804DC
    229
    230#define mmTPC2_RTR_HBW_RANGE_BASE_H_0                                0xE804E0
    231
    232#define mmTPC2_RTR_HBW_RANGE_BASE_H_1                                0xE804E4
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    234#define mmTPC2_RTR_HBW_RANGE_BASE_H_2                                0xE804E8
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    239
    240#define mmTPC2_RTR_HBW_RANGE_BASE_H_5                                0xE804F4
    241
    242#define mmTPC2_RTR_HBW_RANGE_BASE_H_6                                0xE804F8
    243
    244#define mmTPC2_RTR_HBW_RANGE_BASE_H_7                                0xE804FC
    245
    246#define mmTPC2_RTR_LBW_RANGE_HIT                                     0xE80500
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    249
    250#define mmTPC2_RTR_LBW_RANGE_MASK_1                                  0xE80514
    251
    252#define mmTPC2_RTR_LBW_RANGE_MASK_2                                  0xE80518
    253
    254#define mmTPC2_RTR_LBW_RANGE_MASK_3                                  0xE8051C
    255
    256#define mmTPC2_RTR_LBW_RANGE_MASK_4                                  0xE80520
    257
    258#define mmTPC2_RTR_LBW_RANGE_MASK_5                                  0xE80524
    259
    260#define mmTPC2_RTR_LBW_RANGE_MASK_6                                  0xE80528
    261
    262#define mmTPC2_RTR_LBW_RANGE_MASK_7                                  0xE8052C
    263
    264#define mmTPC2_RTR_LBW_RANGE_MASK_8                                  0xE80530
    265
    266#define mmTPC2_RTR_LBW_RANGE_MASK_9                                  0xE80534
    267
    268#define mmTPC2_RTR_LBW_RANGE_MASK_10                                 0xE80538
    269
    270#define mmTPC2_RTR_LBW_RANGE_MASK_11                                 0xE8053C
    271
    272#define mmTPC2_RTR_LBW_RANGE_MASK_12                                 0xE80540
    273
    274#define mmTPC2_RTR_LBW_RANGE_MASK_13                                 0xE80544
    275
    276#define mmTPC2_RTR_LBW_RANGE_MASK_14                                 0xE80548
    277
    278#define mmTPC2_RTR_LBW_RANGE_MASK_15                                 0xE8054C
    279
    280#define mmTPC2_RTR_LBW_RANGE_BASE_0                                  0xE80550
    281
    282#define mmTPC2_RTR_LBW_RANGE_BASE_1                                  0xE80554
    283
    284#define mmTPC2_RTR_LBW_RANGE_BASE_2                                  0xE80558
    285
    286#define mmTPC2_RTR_LBW_RANGE_BASE_3                                  0xE8055C
    287
    288#define mmTPC2_RTR_LBW_RANGE_BASE_4                                  0xE80560
    289
    290#define mmTPC2_RTR_LBW_RANGE_BASE_5                                  0xE80564
    291
    292#define mmTPC2_RTR_LBW_RANGE_BASE_6                                  0xE80568
    293
    294#define mmTPC2_RTR_LBW_RANGE_BASE_7                                  0xE8056C
    295
    296#define mmTPC2_RTR_LBW_RANGE_BASE_8                                  0xE80570
    297
    298#define mmTPC2_RTR_LBW_RANGE_BASE_9                                  0xE80574
    299
    300#define mmTPC2_RTR_LBW_RANGE_BASE_10                                 0xE80578
    301
    302#define mmTPC2_RTR_LBW_RANGE_BASE_11                                 0xE8057C
    303
    304#define mmTPC2_RTR_LBW_RANGE_BASE_12                                 0xE80580
    305
    306#define mmTPC2_RTR_LBW_RANGE_BASE_13                                 0xE80584
    307
    308#define mmTPC2_RTR_LBW_RANGE_BASE_14                                 0xE80588
    309
    310#define mmTPC2_RTR_LBW_RANGE_BASE_15                                 0xE8058C
    311
    312#define mmTPC2_RTR_RGLTR                                             0xE80590
    313
    314#define mmTPC2_RTR_RGLTR_WR_RESULT                                   0xE80594
    315
    316#define mmTPC2_RTR_RGLTR_RD_RESULT                                   0xE80598
    317
    318#define mmTPC2_RTR_SCRAMB_EN                                         0xE80600
    319
    320#define mmTPC2_RTR_NON_LIN_SCRAMB                                    0xE80604
    321
    322#endif /* ASIC_REG_TPC2_RTR_REGS_H_ */