cachepc-linux

Fork of AMDESE/linux with modifications for CachePC side-channel attack
git clone https://git.sinitax.com/sinitax/cachepc-linux
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tpc6_cmdq_regs.h (5085B)

      1/* SPDX-License-Identifier: GPL-2.0
      2 *
      3 * Copyright 2016-2018 HabanaLabs, Ltd.
      4 * All Rights Reserved.
      5 *
      6 */
      7
      8/************************************
      9 ** This is an auto-generated file **
     10 **       DO NOT EDIT BELOW        **
     11 ************************************/
     12
     13#ifndef ASIC_REG_TPC6_CMDQ_REGS_H_
     14#define ASIC_REG_TPC6_CMDQ_REGS_H_
     15
     16/*
     17 *****************************************
     18 *   TPC6_CMDQ (Prototype: CMDQ)
     19 *****************************************
     20 */
     21
     22#define mmTPC6_CMDQ_GLBL_CFG0                                        0xF89000
     23
     24#define mmTPC6_CMDQ_GLBL_CFG1                                        0xF89004
     25
     26#define mmTPC6_CMDQ_GLBL_PROT                                        0xF89008
     27
     28#define mmTPC6_CMDQ_GLBL_ERR_CFG                                     0xF8900C
     29
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     31
     32#define mmTPC6_CMDQ_GLBL_ERR_ADDR_HI                                 0xF89014
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     34#define mmTPC6_CMDQ_GLBL_ERR_WDATA                                   0xF89018
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     36#define mmTPC6_CMDQ_GLBL_SECURE_PROPS                                0xF8901C
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     41
     42#define mmTPC6_CMDQ_GLBL_STS1                                        0xF89028
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     45
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     47
     48#define mmTPC6_CMDQ_CQ_ARUSER                                        0xF890B8
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     50#define mmTPC6_CMDQ_CQ_PTR_LO                                        0xF890C0
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     70#define mmTPC6_CMDQ_CQ_RD_RATE_LIM_EN                                0xF890F0
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     74#define mmTPC6_CMDQ_CQ_RD_RATE_LIM_SAT                               0xF890F8
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    100#define mmTPC6_CMDQ_CP_LDMA_SRC_BASE_HI_OFFSET                       0xF89148
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    110#define mmTPC6_CMDQ_CP_FENCE1_RDATA                                  0xF8915C
    111
    112#define mmTPC6_CMDQ_CP_FENCE2_RDATA                                  0xF89160
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    114#define mmTPC6_CMDQ_CP_FENCE3_RDATA                                  0xF89164
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    118#define mmTPC6_CMDQ_CP_FENCE1_CNT                                    0xF8916C
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    120#define mmTPC6_CMDQ_CP_FENCE2_CNT                                    0xF89170
    121
    122#define mmTPC6_CMDQ_CP_FENCE3_CNT                                    0xF89174
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    124#define mmTPC6_CMDQ_CP_STS                                           0xF89178
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    126#define mmTPC6_CMDQ_CP_CURRENT_INST_LO                               0xF8917C
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    128#define mmTPC6_CMDQ_CP_CURRENT_INST_HI                               0xF89180
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    130#define mmTPC6_CMDQ_CP_BARRIER_CFG                                   0xF89184
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    132#define mmTPC6_CMDQ_CP_DBG_0                                         0xF89188
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    134#define mmTPC6_CMDQ_CQ_BUF_ADDR                                      0xF89308
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    136#define mmTPC6_CMDQ_CQ_BUF_RDATA                                     0xF8930C
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    138#endif /* ASIC_REG_TPC6_CMDQ_REGS_H_ */