cachepc-linux

Fork of AMDESE/linux with modifications for CachePC side-channel attack
git clone https://git.sinitax.com/sinitax/cachepc-linux
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tpc6_rtr_regs.h (12352B)


      1/* SPDX-License-Identifier: GPL-2.0
      2 *
      3 * Copyright 2016-2018 HabanaLabs, Ltd.
      4 * All Rights Reserved.
      5 *
      6 */
      7
      8/************************************
      9 ** This is an auto-generated file **
     10 **       DO NOT EDIT BELOW        **
     11 ************************************/
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     14#define ASIC_REG_TPC6_RTR_REGS_H_
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     17 *****************************************
     18 *   TPC6_RTR (Prototype: TPC_RTR)
     19 *****************************************
     20 */
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    260#define mmTPC6_RTR_LBW_RANGE_MASK_6                                  0xF80528
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    266#define mmTPC6_RTR_LBW_RANGE_MASK_9                                  0xF80534
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    270#define mmTPC6_RTR_LBW_RANGE_MASK_11                                 0xF8053C
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    272#define mmTPC6_RTR_LBW_RANGE_MASK_12                                 0xF80540
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    274#define mmTPC6_RTR_LBW_RANGE_MASK_13                                 0xF80544
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    276#define mmTPC6_RTR_LBW_RANGE_MASK_14                                 0xF80548
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    280#define mmTPC6_RTR_LBW_RANGE_BASE_0                                  0xF80550
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    282#define mmTPC6_RTR_LBW_RANGE_BASE_1                                  0xF80554
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    284#define mmTPC6_RTR_LBW_RANGE_BASE_2                                  0xF80558
    285
    286#define mmTPC6_RTR_LBW_RANGE_BASE_3                                  0xF8055C
    287
    288#define mmTPC6_RTR_LBW_RANGE_BASE_4                                  0xF80560
    289
    290#define mmTPC6_RTR_LBW_RANGE_BASE_5                                  0xF80564
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    292#define mmTPC6_RTR_LBW_RANGE_BASE_6                                  0xF80568
    293
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    295
    296#define mmTPC6_RTR_LBW_RANGE_BASE_8                                  0xF80570
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    299
    300#define mmTPC6_RTR_LBW_RANGE_BASE_10                                 0xF80578
    301
    302#define mmTPC6_RTR_LBW_RANGE_BASE_11                                 0xF8057C
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    304#define mmTPC6_RTR_LBW_RANGE_BASE_12                                 0xF80580
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    306#define mmTPC6_RTR_LBW_RANGE_BASE_13                                 0xF80584
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    312#define mmTPC6_RTR_RGLTR                                             0xF80590
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    314#define mmTPC6_RTR_RGLTR_WR_RESULT                                   0xF80594
    315
    316#define mmTPC6_RTR_RGLTR_RD_RESULT                                   0xF80598
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    318#define mmTPC6_RTR_SCRAMB_EN                                         0xF80600
    319
    320#define mmTPC6_RTR_NON_LIN_SCRAMB                                    0xF80604
    321
    322#endif /* ASIC_REG_TPC6_RTR_REGS_H_ */